Return-Path: Received: (majordomo@vger.kernel.org) by vger.kernel.org via listexpand id S1754770AbaJ1PRj (ORCPT ); Tue, 28 Oct 2014 11:17:39 -0400 Received: from mail.karo-electronics.de ([81.173.242.67]:65222 "EHLO mail.karo-electronics.de" rhost-flags-OK-OK-OK-OK) by vger.kernel.org with ESMTP id S1751386AbaJ1PRi convert rfc822-to-8bit (ORCPT ); Tue, 28 Oct 2014 11:17:38 -0400 Date: Tue, 28 Oct 2014 16:16:56 +0100 From: Lothar =?UTF-8?B?V2HDn21hbm4=?= To: Soren Brinkmann Cc: Linus Walleij , linux-arm-kernel@lists.infradead.org, Steffen Trumtrar , Michal Simek , linux-kernel@vger.kernel.org Subject: Re: [PATCH RFC v2 1/8] pinctrl: Add driver for Zynq Message-ID: <20141028161656.6fb55199@ipc1.ka-ro> In-Reply-To: <1413479495-14206-2-git-send-email-soren.brinkmann@xilinx.com> References: <1413479495-14206-1-git-send-email-soren.brinkmann@xilinx.com> <1413479495-14206-2-git-send-email-soren.brinkmann@xilinx.com> Organization: Ka-Ro electronics GmbH X-Mailer: Claws Mail 3.8.1 (GTK+ 2.24.10; x86_64-pc-linux-gnu) Mime-Version: 1.0 Content-Type: text/plain; charset=UTF-8 Content-Transfer-Encoding: 8BIT Sender: linux-kernel-owner@vger.kernel.org List-ID: X-Mailing-List: linux-kernel@vger.kernel.org Hi, Soren Brinkmann wrote: > Signed-off-by: Soren Brinkmann > --- > changes since RFC: > - use syscon/regmap to access registers in SLCR space > - add pinctrl to zc702 DT > - rebase to 3.18: rename enable -> set_mux > - add kernel-doc > - support pinconf > - supported attributes > - pin-bias: pull up, tristate, disable > - slew-rate: 0 == slow, 1 == fast; generic pinconf does not display > argument > [...] > +struct zynq_pctrl_group zynq_pctrl_groups[] = { > + DEFINE_ZYNQ_PINCTRL_GRP(ethernet0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(ethernet1_0), > + DEFINE_ZYNQ_PINCTRL_GRP(mdio0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(mdio1_0), > + DEFINE_ZYNQ_PINCTRL_GRP(qspi0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(qspi1_0), > + DEFINE_ZYNQ_PINCTRL_GRP(qspi_fbclk), > + DEFINE_ZYNQ_PINCTRL_GRP(qspi_cs1), > + DEFINE_ZYNQ_PINCTRL_GRP(spi0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(spi0_1), > + DEFINE_ZYNQ_PINCTRL_GRP(spi0_2), > + DEFINE_ZYNQ_PINCTRL_GRP(spi1_0), > + DEFINE_ZYNQ_PINCTRL_GRP(spi1_1), > + DEFINE_ZYNQ_PINCTRL_GRP(spi1_2), > + DEFINE_ZYNQ_PINCTRL_GRP(spi1_3), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio0_1), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio0_2), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_0), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_1), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_2), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_3), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio0_emio_wp), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio0_emio_cd), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_emio_wp), > + DEFINE_ZYNQ_PINCTRL_GRP(sdio1_emio_cd), > + DEFINE_ZYNQ_PINCTRL_GRP(smc0_nor), > + DEFINE_ZYNQ_PINCTRL_GRP(smc0_nor_cs1), > + DEFINE_ZYNQ_PINCTRL_GRP(smc0_nor_addr25), > + DEFINE_ZYNQ_PINCTRL_GRP(smc0_nand), > + DEFINE_ZYNQ_PINCTRL_GRP(can0_0), > + DEFINE_ZYNQ_PINCTRL_GRP(can0_1), > + DEFINE_ZYNQ_PINCTRL_GRP(can0_2), > + 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[...] > +#define DEFINE_ZYNQ_PINMUX_FUNCTION(fname, mval) \ > + [ZYNQ_PMUX_##fname] = { \ > + .name = #fname, \ > + .groups = fname##_groups, \ > + .ngroups = ARRAY_SIZE(fname##_groups), \ > + .mux_val = mval \ > + } > + dto. [...] > +#define DEFINE_ZYNQ_PINMUX_FUNCTION_MUX(fname, mval, mux, mask, shift) \ > + [ZYNQ_PMUX_##fname] = { \ > + .name = #fname, \ > + .groups = fname##_groups, \ > + .ngroups = ARRAY_SIZE(fname##_groups), \ > + .mux_val = mval, \ > + .mux_mask = mask, \ > + .mux_shift = shift \ dto. [...] > +static const struct zynq_pinmux_function zynq_pmux_functions[] = { > + DEFINE_ZYNQ_PINMUX_FUNCTION(ethernet0, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(ethernet1, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(mdio0, 0x40), > + DEFINE_ZYNQ_PINMUX_FUNCTION(mdio1, 0x50), > + DEFINE_ZYNQ_PINMUX_FUNCTION(qspi0, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(qspi1, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(qspi_fbclk, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(qspi_cs1, 1), > + DEFINE_ZYNQ_PINMUX_FUNCTION(spi0, 0x50), > + DEFINE_ZYNQ_PINMUX_FUNCTION(spi1, 0x50), > + DEFINE_ZYNQ_PINMUX_FUNCTION(sdio0, 0x40), > + DEFINE_ZYNQ_PINMUX_FUNCTION(sdio0_pc, 0xc), > + DEFINE_ZYNQ_PINMUX_FUNCTION_MUX(sdio0_wp, 0, 130, ZYNQ_SDIO_WP_MASK, > + ZYNQ_SDIO_WP_SHIFT), > + DEFINE_ZYNQ_PINMUX_FUNCTION_MUX(sdio0_cd, 0, 130, ZYNQ_SDIO_CD_MASK, > + ZYNQ_SDIO_CD_SHIFT), > + DEFINE_ZYNQ_PINMUX_FUNCTION(sdio1, 0x40), > + DEFINE_ZYNQ_PINMUX_FUNCTION(sdio1_pc, 0xc), > + DEFINE_ZYNQ_PINMUX_FUNCTION_MUX(sdio1_wp, 0, 134, ZYNQ_SDIO_WP_MASK, > + ZYNQ_SDIO_WP_SHIFT), > + DEFINE_ZYNQ_PINMUX_FUNCTION_MUX(sdio1_cd, 0, 134, ZYNQ_SDIO_CD_MASK, > + ZYNQ_SDIO_CD_SHIFT), > + DEFINE_ZYNQ_PINMUX_FUNCTION(smc0_nor, 4), > + DEFINE_ZYNQ_PINMUX_FUNCTION(smc0_nor_cs1, 8), > + DEFINE_ZYNQ_PINMUX_FUNCTION(smc0_nor_addr25, 4), > + DEFINE_ZYNQ_PINMUX_FUNCTION(smc0_nand, 8), > + DEFINE_ZYNQ_PINMUX_FUNCTION(can0, 0x10), > + DEFINE_ZYNQ_PINMUX_FUNCTION(can1, 0x10), > + DEFINE_ZYNQ_PINMUX_FUNCTION(uart0, 0x70), > + DEFINE_ZYNQ_PINMUX_FUNCTION(uart1, 0x70), > + DEFINE_ZYNQ_PINMUX_FUNCTION(i2c0, 0x20), > + DEFINE_ZYNQ_PINMUX_FUNCTION(i2c1, 0x20), > + DEFINE_ZYNQ_PINMUX_FUNCTION(ttc0, 0x60), > + DEFINE_ZYNQ_PINMUX_FUNCTION(ttc1, 0x60), > + DEFINE_ZYNQ_PINMUX_FUNCTION(swdt0, 0x30), > + DEFINE_ZYNQ_PINMUX_FUNCTION(gpio0, 0) dto. [...] > +static const struct pinctrl_ops zynq_pctrl_ops = { > + .get_groups_count = zynq_pctrl_get_groups_count, > + .get_group_name = zynq_pctrl_get_group_name, > + .get_group_pins = zynq_pctrl_get_group_pins, > + .dt_node_to_map = pinconf_generic_dt_node_to_map_group, > + .dt_free_map = pinctrl_utils_dt_free_map dto. Lothar Waßmann -- ___________________________________________________________ Ka-Ro electronics GmbH | Pascalstraße 22 | D - 52076 Aachen Phone: +49 2408 1402-0 | Fax: +49 2408 1402-10 Geschäftsführer: Matthias Kaussen Handelsregistereintrag: Amtsgericht Aachen, HRB 4996 www.karo-electronics.de | info@karo-electronics.de ___________________________________________________________ -- To unsubscribe from this list: send the line "unsubscribe linux-kernel" in the body of a message to majordomo@vger.kernel.org More majordomo info at http://vger.kernel.org/majordomo-info.html Please read the FAQ at http://www.tux.org/lkml/